一種乘同余偽隨機(jī)序列快速實(shí)現(xiàn)的FPGA設(shè)計(jì)
所屬分類：技術(shù)論文
上傳者：aet
文檔大小：221 K
標(biāo)簽： FPGA
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文檔介紹：針對一類乘同余運(yùn)算，提出了一種快速算法。采用1個(gè)32位乘法、2個(gè)32位加法、少量移位操作和1個(gè)最高位分離操作方法，避免了連續(xù)減法和除法運(yùn)算。采用硬件語言設(shè)計(jì)了快速算法。在此算法的基礎(chǔ)上，設(shè)計(jì)了基于FPGA的偽隨機(jī)序列發(fā)生器。
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