復雜數字視頻信號處理器IP核設計
所屬分類：技術論文
上傳者：aet
文檔大小：333 K
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文檔介紹：針對復雜數字視頻處理電路的數據處理量大、處理過程復雜、系統工作頻率高、涉及到復雜嚴格的時序邏輯關系的特點，按照場序制彩色FSC原理和VESA標準，采用現代EDA技術，設計了一個適于FPGA實現的、應用于MD800G6驅動控制器中的復雜數字視頻信號處理器IP核，給出了各個部分的設計。仿真結果表明了設計的可行性。該設計具有可靠性高、升級容易等特點。
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