一種20 MS/s基于VCO比較器的二階噪聲整形SAR ADC設計
所屬分類:技術論文
上傳者:zhoubin333
文檔大小:650 K
標簽: 模數轉換器 噪聲整形 VCO比較器
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文檔介紹:基于壓控振蕩器(VCO)結構的比較器,提出了一種二階噪聲整形逐次逼近型(NS-SAR)模數轉換器(ADC)。首先采用對電源電壓敏感度較低且噪聲性能更優越的VCO比較器,隨后通過動態放大器優化噪聲傳遞函數的零極點,最后通過噪聲整形結構抑制信號帶內噪聲。基于180 nm CMOS 工藝,設計了一款12位20 MS/s NS-SAR ADC。仿真結果表明,在1.3 V電源電壓下,功耗為1.12 mW,過采樣率(OSR)為8時,信號噪聲失真比(SNDR)為72.7 dB,無雜散動態范圍(SFDR)為88 dB,優值(FoMs)為163 dB;并且在1.3~1.8 V電源電壓范圍內,其有效位數(ENOB)>11.7 bit。
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