基于Innovus改善芯片繞線資源的電源網(wǎng)絡(luò)布線方法
所屬分類：技術(shù)論文
上傳者：wwei
文檔大小：4163 K
標(biāo)簽： 物理設(shè)計(jì) 單元密度 電源規(guī)劃
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文檔介紹：隨著集成電路的集成度越來(lái)越高，芯片的面積越來(lái)越小，芯片內(nèi)單元密度會(huì)隨之增加，這將為芯片的后端物理設(shè)計(jì)帶來(lái)諸多的挑戰(zhàn)。其中芯片面積的減小直接影響布線資源，導(dǎo)致布線擁塞，以此造成芯片線路無(wú)法繞通以及時(shí)序和串?dāng)_的問(wèn)題。提出了一種改進(jìn)的電源網(wǎng)絡(luò)的布線方法，極大提升了信號(hào)線的走線空間利用率，有效解決了高集成度芯片的短路問(wèn)題。
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